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RD40PD01三菱高速I/O控制模塊參數(shù)說明：

輸入12點(diǎn)(DC5/24V/差分共用),輸出8點(diǎn)(DC時(shí)),、6點(diǎn)(差分時(shí)),最大脈沖輸入輸出速度DC時(shí)最200k pulse/s、差分時(shí)最大8M(2MHz),，40 針連接器,。

   RD40PD01三菱高速I/O控制模塊的特點(diǎn) 

  . 繼承發(fā)展了輸入輸出模塊和高速計(jì)數(shù)器模塊的功能；
  . 豐富的輸入輸出點(diǎn)數(shù),、功能組合,，擴(kuò)展了應(yīng)用范圍；
  . I/O 響應(yīng)時(shí)間減短至 1µs 以下,；
  . 硬件運(yùn)算使處理時(shí)間的偏差減少至納秒單位,；
  . 無需深度了解 FPGA ，也能創(chuàng)建硬件邏輯,；
  . 選擇然后連接,，直觀的設(shè)置工具；
  . 引進(jìn)后可立即驗(yàn)證各邏輯間的連接,。

  三菱柔性高速I/O控制模塊RD40PD01產(chǎn)品規(guī)格說明：

  1,、性能規(guī)格
 [輸入點(diǎn)數(shù)] 12(DC5/24V/差分共用)
 [輸出點(diǎn)數(shù)] 
 [DC時(shí)]：8(DC5 24V,0.1A/點(diǎn))
 [差分時(shí)]：6點(diǎn)
 [中斷點(diǎn)數(shù)] 8點(diǎn)
 [輸入響應(yīng)時(shí)間] 1µs 以下
 [輸出響應(yīng)時(shí)間] 1µs 以下
 [最大脈沖輸入速度(pulse/s)]
 [DC時(shí)]：200k(200kHz)
 [差分時(shí)]：8M(2MHz)
 [最大脈沖輸出速度(pulse/s)]
 [DC時(shí)]：200k(200kHz)
 [差分時(shí)]：8M(2MHz)
 [使用基本塊組合可執(zhí)行的主要功能]：脈沖計(jì)數(shù)、一致檢測,、凸輪開關(guān),、高精度脈沖輸出、 PWM 輸出,、比率設(shè)置,、脈沖測定、電氣接口轉(zhuǎn)換
 [主要硬件邏輯的處理時(shí)間]：邏輯運(yùn)算：最小87.5ns ,，一致輸出：最小137.5ns ,，凸輪開關(guān)：最小262.5ns
 [外部配線連接方式]：40 針連接器 *2,，A6CON1，A6CON2,，A6CON4
 [輸入輸出占有點(diǎn)數(shù)]：32點(diǎn)
 [DC5V內(nèi)部消費(fèi)電流]：0.76A
 [外形尺寸H*W*D]：106*27.8*110mm
 [重量]：0.16kg

  2,、基本塊
 [外部輸入塊] 
  . 邏輯選擇 ：反轉(zhuǎn)、非反轉(zhuǎn)
  . 濾波器時(shí)間(通用輸入)：0µs/10µs/50µs/0.1ms /0.2ms/0.4ms/0.6ms/1ms/5ms
  . 濾波器時(shí)間(脈沖輸入)：10k/100k/200k/500k/1M/2M/4M/8M pulse/s

 [并行編碼器塊] 
  . 輸入數(shù)據(jù)類型：純二進(jìn)制,、格雷碼,、 BCD
  . 數(shù)據(jù)長：1bit~12bit

 [SSI 編碼器塊] 
  . 輸入數(shù)據(jù)類型：純二進(jìn)制、格雷碼
  . 數(shù)據(jù)長：1bit~32bit
  . 傳送速度：100kHz/200kHz/300kHz/400kHz/500kHz/1.0MHz/1.5MHz/2.0MHz

 [多功能計(jì)數(shù)器塊] 
  .計(jì)數(shù)器定時(shí)器塊
  .形式：加法,、減法,、線性計(jì)數(shù)器模式、環(huán)形計(jì)數(shù)器模式,、加法模式,、
  .預(yù)置計(jì)數(shù)器功能、鎖存計(jì)數(shù)器功能,、內(nèi)部時(shí)鐘功能
  .內(nèi)部時(shí)鐘：25ns/50ns/0.1µs/1µs/10µs/100µs/1ms
  .計(jì)數(shù)范圍：32位帶符號二進(jìn)制(-2147483648~2147483647),、32位無符號二進(jìn)制( 0~4294967295)
  .16位帶符號二進(jìn)制(-32768~32767)、16位無符號二進(jìn)制(0~65535)
  .比較塊
  .比較值：與計(jì)數(shù)范圍相同
  .比較模式：= ,、 > ,、 < 、 ≥ ,、 ≤ ,、 <>
  .凸輪開關(guān)塊：16步
  .設(shè)置/復(fù)位塊
  .將Set端子中輸入的信號設(shè)置為觸發(fā)，輸出 High 固定信號
  .將Reset端子中輸入的信號設(shè)置為觸發(fā),，輸出 Low 固定信號

 [邏輯運(yùn)算類型] AND ,、 OR 、 XOR

 [外部輸出塊] 
  . 邏輯選擇：反轉(zhuǎn),、非反轉(zhuǎn)
  . 延遲時(shí)間：無/12.5ns/25ns/50ns/0.1µs/1µs/10µs/100µs/1ms/模塊間同步周期